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ATmega128
Table 106. ATmega128 Boundary-scan Order (Continued)
Bit Number
103
102
101
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
80
79
78
77
76
75
74
73
72
71
70
69
68
Signal Name
RSTT
RSTHV
EXTCLKEN
OSCON
RCOSCEN
OSC32EN
EXTCLK (XTAL1)
OSCCK
RCCK
OSC32CK
T W IEN
PD0.Data
PD0.Control
PD0.Pullup_Enable
PD1.Data
PD1.Control
PD1.Pullup_Enable
PD2.Data
PD2.Control
PD2.Pullup_Enable
PD3.Data
PD3.Control
PD3.Pullup_Enable
PD4.Data
PD4.Control
PD4.Pullup_Enable
PD5.Data
PD5.Control
PD5.Pullup_Enable
PD6.Data
PD6.Control
PD6.Pullup_Enable
PD7.Data
PD7.Control
PD7.Pullup_Enable
PG0.Data
Module
Reset Logic
(Observe-only)
Enable signals for main Clock/Oscillators
Clock input and Oscillators for the main clock
(Observe-only)
T W I
Port D
Port G
269
2467X–AVR–06/11
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